NB3N51044

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Clock Generator, 3.3 V, Crystal to 100 MHz / 125MHz, Quad HCSL / LVDS

制造商：ON

中文数据手册

产品信息

The NB3N51044 is a precision, low phase noise clock generator that supports PCI Express and sRIO clock requirements. The device accepts a 25 MHz fundamental mode parallel resonant crystal or a 25 MHz single ended reference clock signal and generates four differential HCSL/LVDS outputs of 100 MHz or 125 MHz clock frequency based on frequency select input F_SEL. NB3N51044 is configurable to bypass the PLL from signal path using BYPASS, and provides the output frequency through the divider network. All clock outputs can be individually enabled / disabled through hardware input pins OE. In addition, device can be reset using Master Reset input pin MR_OE#.

Output frequency selection of 100 MHz or 125 MHz
Typical Phase Jitter @ 125 MHz (integrated 1.875 MHz to 20 MHz): 0.2 ps
Typical Cycle-cycle Jitter @ 100 MHz (10k cycles): 20 ps
Uses 25 MHz Fundamental Crystal or Reference Clock Input
Four Low Skew HCSL or LVDS Outputs
Individual OE Tri-states Output
Master Reset and BYPASS modes
PCIe Gen 1, Gen 2, Gen 3 Compliant
Operating Supply Voltage Range 3.3 V ± 5%
Industrial Temperature Range-40°C to +85°C

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型号	制造商	描述	购买
NB3N51044DTG	ON	IC CLK GEN HCSL/LVDS 28W-TSSOP	立即购买
NB3N51044DTR2G	ON	IC CLK GEN HCSL/LVDS 28W-TSSOP	立即购买

技术资料

标题	类型	大小（KB）	下载
28 Lead TSSOP	PDF	63	点击下载
3.3 V, Crystal to 100 MHz / 125 MHz Quad HCSL / LVDS Clock Generator	PDF	213	点击下载
A System Designer"s Guide for Building a PCIe Clock Tree while Addressing Timing Challenges	PDF	179	点击下载
NB3N51044 IBIS Model	UNKNOW	95	点击下载

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