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3.3 V PCIe 时钟发生器
IDT 新推 6 输出和 8 输出 3.3 V 时钟发生器（3.3 V PCIe Clock Generator），扩充了其低功耗 PCI Express® (PCIe) 时钟发生器组合的阵容
发布时间：2018-06-14
IDT 6 输出和 8 输出 3.3 V 时钟发生器工作时的功耗约为传统 PCIe 时钟器件的 1/5，有效地解决了发热问题。
9FGL06 和 9FGL08 采用集成端子、超紧凑 5 mm x 5 mm 和 6mm x 6mm 封装，所需板面积最多可减少 90%。 工厂可编程版本可进行器件快速优化，以恰如其分地满足客户要求。 预计到即将实施的 PCIe Gen4 规范，SoC 友好型器件远超 PCIe Gen3 规范关于相位抖动的要求，并且还适用于要求相位抖动小于 3 ps rms 12 k 至 20 M 相位抖动的应用，如千兆位以太网和其它高性能应用。
这种 3.3 V 器件与 IDT 大获成功的 1.5 V 9FGU 系列、1.8 V 9FGV 系列 PCIe 时钟发生器兼容引脚。 定时系列针对消费类、高性能应用中的电源和空间受限型设计，能在降低总拥有成本的同时实现企业级性能。 潜在的应用包括多功能打印机、服务器、机顶盒和固态硬盘。 整个系列符合 1 至 3 代 PCIe 标准。
IDT 计划在上述产品之后紧接着推出 3.3 V 版低功耗 PCIe 缓冲器和多路复用器，并兼容大获成功的 9DBU/V 和 9DMU/V 系列。
9FGL PCIe 时钟发生器系列还包括 2、4、6 或者 8 输出器件。 这些时钟发生器支持常见的 PCIe 时钟架构（带或不带扩频频谱）和 PCIe 独立基准 (IR) 时钟架构（非扩频）。 这些器件还提供基准时钟副本，可在设计中节省晶体。
3.3 V PCIe 时钟发生器特性
1 - 3.3 V LVCMOS REF 输出，具有“唤醒 LAN (WOL)” 支持功能
可直接连接 100Ω (xx41) 或 85Ω (xx51) 传输线路，比标准 PCIe 器件少 24 个电阻器
SMVus 可选特性有助于按照客户要求进行优化
41 和 51 器件均包含默认配置；器件运行不需要 SMBus 接口
OE# 引脚；支持 DIF 电源管理
两个可选择的 SMBus 地址；多个器件可轻松共享 SMBus 部分
P1 器件允许对客户定义的 SMBus 上电默认功能进行工厂编程；允许按照客户要求进行精确优化
在 PLL 锁定前 DIF 输出一直保持锁定状态；洁净的系统启动
在 DIF 输出上可选择引脚/SMBus 的 0%、-0.25% 或 -0.5% 扩频；将每个应用的 EMI 和相位抖动降至最低
25 MHz 默认输入频率；外部晶体如 IDT 603-25-150 (25 MHz)；支持严格的 ppm，合成误差为 0 ppm
节省空间的封装；最小板空间
| 图片 | 数据手册 | 产品型号 | 产品分类 | 产品描述 | 价格 | 操作 |
|---|---|---|---|---|---|---|
 | | 9FGL0641AKILF | 专用时钟/计时芯片-时钟管理 | ICCLOCKGENERATOR3.3V | 在线订购 |
| 图片 | 数据手册 | 产品型号 | 产品分类 | 产品描述 | 价格 | 操作 |
|---|---|---|---|---|---|---|
 | | EVK9FGL0841 | 开发板/评估板/验证板（废弃） | EVAL BOARD FOR 9FGL0841 | 在线订购 | |
 | | 9FGL0841AKILF | 专用时钟/计时芯片-时钟管理 | ICCLOCKGENERATOR3.3V | 在线订购 |
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