MC100LVEP14

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5 Differential ECL/PECL/HSTL Clock / Data Fanout Buffer

制造商：ON

中文数据手册

产品信息

The MC100LVEP14 is a low skew 1 to 5 differential driver, designed with clock distribution in mind, accepting two clock sources into an input multiplexer. The ECL/PECL input signals can be either differential or single-ended (if the VBB output is used). HSTL inputs can be used when the LVEP14 is operating under PECL conditions.

100 ps Device-to-Device Skew
25 ps Within Device Skew
400 ps Typical Propagation Delay
Maximum Frequency > 2 GHz Typical
PECL and HSTL Mode: V
= 2.375 V to 3.8 V with V
= 0 V
NECL Mode: V
= 0 V with V
= -2.375 V to -3.8 V
LVDS Input Compatible
Open Input Default State

电路图、引脚图和封装图

MC100LVEP14电路图

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型号	制造商	描述	购买
MC100LVEP14DTR2G	ON	IC CLK BUFFER 2:5 2.5GHZ 20TSSOP	立即购买
MC100LVEP14DTG	ON	IC CLK BUFFER 2:5 2.5GHZ 20TSSOP	立即购买

技术资料

标题	类型	大小（KB）	下载
AC Characteristics of ECL Devices	PDF	896	点击下载
ECL Clock Distribution Techniques	PDF	54	点击下载
Interfacing Between LVDS and ECL	PDF	121	点击下载
Designing with PECL (ECL at +5.0 V)	PDF	102	点击下载
The ECL Translator Guide	PDF	142	点击下载
Odd Number Divide By Counters with 50% Outputs and Synchronous Clocks	PDF	90	点击下载
ECLinPS, ECLinPS Lite, ECLinPS Plus and GigaComm Marking and Ordering Information Guide	PDF	71	点击下载
Storage and Handling of Drypack Surface Mount Device	PDF	49	点击下载

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