MC100EPT26

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2 Fanout Differential LVPECL / LVDS to LVTTL

制造商：ON

中文数据手册

产品信息

The MC100EPT26 is a 1:2 Fanout Differential LVPECL to LVTTL translator. Because LVPECL (Positive ECL) levels are used only +3.3V and ground are required. The small outline 8-lead SOIC package and the 1:2 fanout design of the EPT26 makes it ideal for applications which require the low skew duplication of a signal in a tightly packed PC board.
The V
output allows the EPT26 to be used in a single-ended input mode. In this mode the V
output is tied to the D0bar input for a non-inverting buffer or the D0 input for an inverting buffer. If used, the V
pin should be bypassed to ground via a 0.01 uF capacitator.

1.4ns Typical Propagation Delay
Maximum Frequency > 275 MHz Typical
The 100 Series Contains Temperature Compensation
Operating Range: V
= 3.0 V to 3.6 V with GND = 0 V
Open Input Default State
Safety Clamp on Inputs
24mA TTL outputs
Q Outputs will default LOW with inputs open or at V
V
Output
Pb-Free Packages are Available

电路图、引脚图和封装图

MC100EPT26电路图

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型号	制造商	描述	购买
MC100EPT26MNR4G	ON	Mixed Signal Translator Unidirectional 1 Circuit 2 Channel 8-DFN (2x2)	立即购买
MC100EPT26DR2G	ON	IC XLATOR LVPECL-LVTTL 8-SOIC	立即购买
MC100EPT26DTR2G	ON	IC XLATOR LVPECL-LVTTL 8-TSSOP	立即购买
MC100EPT26DTG	ON	IC XLATOR PECL-TTL 1:2FNO 8TSSOP	立即购买
MC100EPT26DG	ON	IC XLATOR PECL-TTL 1:2 FNO 8SOIC	立即购买

技术资料

标题	类型	大小（KB）	下载
AC Characteristics of ECL Devices	PDF	896	点击下载
ECL Clock Distribution Techniques	PDF	54	点击下载
Interfacing Between LVDS and ECL	PDF	121	点击下载
Designing with PECL (ECL at +5.0 V)	PDF	102	点击下载
The ECL Translator Guide	PDF	142	点击下载
Odd Number Divide By Counters with 50% Outputs and Synchronous Clocks	PDF	90	点击下载
ECLinPS, ECLinPS Lite, ECLinPS Plus and GigaComm Marking and Ordering Information Guide	PDF	71	点击下载
Storage and Handling of Drypack Surface Mount Device	PDF	49	点击下载

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