MC100EP91

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PECL to NECL Translator

制造商：ON

中文数据手册

产品信息

The MC100EP91 is a triple AnyLevel™ positive input to NECL output translator. The device accepts LVPECL, LVTTL, LVCMOS, HSTL, CML or LVDS signals, and translates them to differential NECL output signals.VEE at -3.0 V to -5.5 V.

Maximum Input Clock Frequency > 2.0 GHz Typical
Maximum Input Data Rate > 2.0 Gb/s Typical
500 ps Typical Propagation Delay
Operating Range: VCC = 2.375 V to 3.8 V; VEE = 3.0 V to 5.5 V; GND = 0 V
Q Output will Default LOW with Inputs Open or at GND

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型号	制造商	描述	购买
MC100EP91DWR2G	ON	TRANSLATOR NECL OUTPUT 20-SOIC	立即购买
MC100EP91MNR2G	ON	TRANSLATOR NECL OUTPUT 24-QFN	立即购买
MC100EP91MNG	ON	TRANSLATOR NECL OUTPUT 24-QFN	立即购买
MC100EP91DWG	ON	TRANSLATOR NECL OUTPUT 20-SOIC	立即购买

技术资料

标题	类型	大小（KB）	下载
AC Characteristics of ECL Devices	PDF	896	点击下载
ECL Clock Distribution Techniques	PDF	54	点击下载
Interfacing Between LVDS and ECL	PDF	121	点击下载
Designing with PECL (ECL at +5.0 V)	PDF	102	点击下载
Odd Number Divide By Counters with 50% Outputs and Synchronous Clocks	PDF	90	点击下载
Interfacing with ECLinPS	PDF	72	点击下载
Termination of ECL Logic Devices	PDF	176	点击下载
Clock Generation and Clock and Data Marking and Ordering Information Guide	PDF	71	点击下载

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