MC100EP33

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3.3 V / 5.0 V ECL ÷·4 Divider

制造商：ON

中文数据手册

产品信息

The MC10/100EP33 is an integrated divide by 4 divider. The differential clock inputs.
The V
pin, an internally generated voltage supply, is available to this device only. For single-ended input conditions, the unused differential input is connected to V
as a switching reference voltage.
V
may also rebias AC coupled inputs. When used, decouple V
and V
via a 0.01 uF capacitor and limit current sourcing or sinking to 0.5mA. When not used, V
should be left open.
The reset pin is asynchronous and is asserted on the rising edge. Upon power-up, the internal flip-flops will attain a random state; the reset allows for the synchronization of multiple EP33's in a system.
The 100 Series contains temperature compensation.

320ps Propagation Delay
Maximum Frequency > 4 GHz Typical
PECL Mode Operating Range: V
= 3.0 V to 5.5 V with V
= 0 V
NECL Mode Operating Range: V
= 0 V with V
= -3.0 V to -5.5 V
Open Input Default State
Safety Clamp on Inputs
Q Output will default LOW with inputs open or at V
V
Output
Pb-Free Packages are Available

电路图、引脚图和封装图

MC100EP33电路图

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型号	制造商	描述	购买
MC100EP33MNR4G	ON	IC DIVIDER BY4 ECL CLK IN 8-DFN	立即购买
MC100EP33DTR2G	ON	IC DIVIDER BY4 ECL CLK IN 8TSSOP	立即购买
MC100EP33DTG	ON	IC DIVIDER DIV X4 ECL CLK 8TSSOP	立即购买
MC100EP33DG	ON	IC DIVIDER DIV X4 ECL CLK 8SOIC	立即购买

技术资料

标题	类型	大小（KB）	下载
3.3 V / 5 V ECL Divide by 4 Divider	PDF	186	点击下载
IBIS Model for mc100ep33dt -5.0V	UNKNOW	5	点击下载
SOIC-8 Narrow Body	PDF	61	点击下载
TSSOP 8 3.0x3.0x0.95 mm	PDF	75	点击下载
DFN8 2.0x2.0x0.9mm, 0.5p	PDF	31	点击下载
MC10EP33_BD.GIF	UNKNOW	5	点击下载
MC10EP33_PKG.GIF	UNKNOW	13	点击下载
AC Characteristics of ECL Devices	PDF	896	点击下载

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