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制造商：ADI/AD
优势和特点
2个可选差分输入
工作频率：4.8 GHz
宽带随机抖动：75 fs rms
片内输入端接
电源：3.3 V
产品详情
ADCLK948是一款超快时钟扇出缓冲器，采用ADI公司专有的XFCB3硅-锗（SiGe）双极性工艺制造，设计用于要求低抖动的高速应用。该器件具有两个差分输入，通过IN_SEL控制引脚进行选择。两个输入均配备中心抽头、差分、100 Ω片内端接电阻，接受直流耦合LVPECL、CML、3.3 V CMOS（单端）以及交流耦合1.8 V CMOS、LVDS和LVPECL输入。提供VREFx引脚用于偏置交流耦合输入。
ADCLK948内置8个全摆幅射极耦合逻辑（ECL）输出驱动器。对于LVPECL（正ECL）工作模式， VCC 偏置至正电源， VEE 偏置至接地。对于ECL工作模式， VCC 偏置至接地， VEE 偏置至负电源。输出级旨在从各端将800 mW直接驱动至端接于VCC -2V的50 Ω负载，从而获得1.6 V的总差分输出摆幅。
ADCLK948采用32引脚LFCSP封装，额定工作温度范围为−40°C至+85°C标准工业温度范围。
应用低抖动时钟分配
时钟与数据信号恢复
电平转换
无线通信
有线通信
医疗和工业成像
自动测试设备（ATE）和高性能仪器仪表
ADCLK948电路图
| 型号 | 制造商 | 描述 | 购买 |
|---|---|---|---|
| ADCLK948BCPZ-REEL7 | - | - | 立即购买 |
| ADCLK948BCPZ | - | - | 立即购买 |
| 标题 | 类型 | 大小（KB） | 下载 |
|---|---|---|---|
| UG-068: Setting Up the Evaluation Board for the ADCLK948 | 211 | 点击下载 |
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...．2倍和28倍。1－11月，燃料电池汽车产销分别完成935辆和948辆，同比分别下降34．4％和29．1％。 香橙会研
许多系统都要求具有多个低抖动系统时钟，以便实现混合 信号处理和定时。本内容将 ADF4351集成锁相环（PLL）和压控振荡器（VCO）与 ADCLK948接口，后者可通过 ADF4351的一路差分输出提供多
采用RD9481微波探测控制电路
如何试验晶体在MAX
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在MAX9485中如
摘要：与典型的“本地”时钟方案相比，集成的多输出时钟发生器有许多优势。本文探讨了集中时钟发生器(如MAX9489和MAX9471)的优点，如：降低系统成本、良好的信号完整性、抑制干
| AD5398A | ADIS16060 | adis16265 | ADG5434 |
| AD7484 | ADM7151 | ADUC7121 | ADV3226 |
| AD7091R | ADV7610 | AD7813 | ADUC7026 |
| ADM4855 | AD537 | ADG5234 | ADuM5411 |
| ADP2109 | AD9748 | AD9558 | ADG5408 |
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