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    AD9540

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    低抖动、基于DDS的时钟发生器和频率合成器

    制造商:ADI/AD

    中文数据手册

    产品信息

    优势和特点

      内在抖动性能< 500 fs

      合成信号频率达2.7 GHz

      时钟信号发生频率达655 MHz

      25 Mb/s写入速度串行I/O控制

      200 MHz鉴频鉴相器输入

      400 MSPS DDS片上可编程边沿延迟,93 fs分辨率频率分辨率<2.33 µHz<2.33 µHz

      655 MHz可编程输入分频器用于鉴频鉴相器(÷M,N) {M,N =1..16}(可旁路)

      8个可编程内部时钟速率

      器件采用1.8 V电源供电I/O、CML驱动器和电荷泵输出采用3.3 V电源供电

      软件控制省电功能

      48引脚LFCSP封装

      可编程电荷泵电流(最高达4 mA)

    产品详情

    AD9540支持多种功能,包括信号合成和低抖动时钟发生,适合各种应用。该器件内置高性能PLL电路,包括灵活的200 MHz鉴频鉴相器和数字控制电荷泵电流。它还可以使低抖动、655 MHz CML模式(PECL兼容)输出驱动器具有可编程压摆率。器件支持最高2.7 GHz的外部VCO速率。片上400 MSPS DDS提供及精密的调谐分辨率和相位编程能力。信息通过一个串行I/O端口载入AD9540中,该端口的器件写入速度为25Mb/s。还可以对AD9540分频器模块进行编程,支持扩频时钟模式。

    AD9540的额定工作温度范围为-40℃至+85℃扩展汽车应用温度范围。

    应用

      为高性能数据转换器提供时钟

      基站时钟应用

      网络(SONET/SDH)时钟

      千兆以太网(GbE)时钟

      仪器仪表时钟电路

    技术资料

    标题类型大小(KB)下载
    AN-1389: 引线框芯片级封装(LFCSP)的建议返修程序 (Rev. 0)PDF652 点击下载
    AN-1389: Recommended Rework Procedure for the Lead Frame Chip Scale Package (LFCSP) (Rev. 0)PDF133 点击下载
    AN-501: Aperture Uncertainty and ADC System Performance (Rev. A)PDF227 点击下载
    AN-756: Sampled Systems and the Effects of Clock Phase Noise and Jitter (Rev. 0)PDF291 点击下载
    AN-769: Generating Multiple Clock Outputs from the AD9540 (Rev. 0)PDF130 点击下载
    AN-939: Super-Nyquist Operation of the AD9912 Yields a High RF Output Signal (Rev. 0)PDF221 点击下载
    AN-837: DDS-Based Clock Jitter Performance vs. DAC Reconstruction Filter Performance (Rev. 0)PDF313 点击下载
    AN-621: Programming the AD9832/AD9835PDF202 点击下载

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