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    AD9516-4

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    14路输出时钟发生器,集成1.6 GHz VCO

    制造商:ADI/AD

    中文数据手册

    产品信息

    优势和特点

      低相位噪声锁相环(PLL) -- 片内VCO调谐范围:1.45 GHz至1.80 GHz-- 可选外部VCO/VCXO,最高达2.4 GHz-- 1路差分或2路单端基准输入

      6对1.6 GHz LVPECL输出-- 每对输出共用1至32分频器和粗调相位延迟-- 加性输出抖动:225 fs rms-- 通道间偏斜成对输出小于10 ps

      4对800 MHz LVDS时钟输出-- 每对输出共用两个级联的1至32分频器和粗调相位延迟-- 加性输出抖动:275 fs rms

      上电时所有输出自动同步

      提供手动输出同步

      64引脚LFCSP

      欲了解更多特性,请参考数据手册

      三对 1.6 GHz LVPECL 输出每对共用1至32分频器和粗调相位延迟加性输出抖动:225 fS均方根值通道间偏斜成对输出小于10 ps

      两对800 MHz LVDS时钟输出每对共用两个级联的1至32分频器和粗调相位延迟加性输出抖动:275 fS均方根值可以精调每路LVDS输出的延迟(ΔT)

      上电时所有输出自动同步

      串行控制端口

      64引脚LFCSP封装

    产品详情

    AD9516-4*提供多路输出时钟分配功能,具有亚皮秒级抖动性能,并且片内集成锁相环(PLL)和电压控制振荡器(VCO)。片内VCO的调谐频率范围为1.45 GHz至1.80 GHz。也可以使用最高2.4 GHz的外部VCO/VCXO。

    AD9516-4具有出色的低抖动和相位噪声特性,可极大地提升数据转换器的性能,并且也有利于其它相位噪声和抖动要求严苛的应用。

    AD9516-4提供6路LVPECL输出(分为三对)、4路LVDS输出(分为两对)和8路CMOS输出(每路LVDS输出对应两路)。LVPECL输出的工作频率达1.6 GHz,LVDS输出的工作频率达800 MHz,CMOS输出的工作频率达250 MHz。

    每对输出均有分频器,其分频比和粗调延迟(或相位)均可以设置。LVPECL输出的分频范围为1至32。LVDS/CMOS输出的分频范围最高可达1024。

    AD9516-4提供64引脚LFCSP封装,可以采用3.3 V单电源供电。将电荷泵电源(VCP)与5V电压相连时,可以使用外部VCO,它需要更宽的电压范围。独立的LVPECL电源可以为2.5 V至3.3 V(标称值)。

    AD9516-4的额定工作温度范围为−40°C至+85°C工业温度范围。

    应用

      低抖动、低相位噪声时钟分配

      10/40/100 Gb/s网络线路卡,包括SONET、同步以太网、OTU2/3/4

      前向纠错(G.710)

      为高速ADC、DAC、DDS、DDC、DUC、MxFE提供时钟

      高性能无线收发器

      自动测试设备(ATE)和高性能仪器仪表

    * AD9516泛指AD9516系列的所有器件。但是,使用AD9516-4时,它仅指AD9516系列的该特定器件。

    电路图、引脚图和封装图

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    型号制造商描述购买
    AD9516-4BCPZ-REEL7-- 立即购买
    AD9516-4BCPZ-- 立即购买

    技术资料

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    AN-835: Understanding High Speed ADC Testing and Evaluation (Rev. B)PDF1423 点击下载
    AN-501: Aperture Uncertainty and ADC System Performance (Rev. A)PDF227 点击下载
    AN-0983: Introduction to Zero-Delay Clock Timing TechniquesPDF162 点击下载
    AN-756: Sampled Systems and the Effects of Clock Phase Noise and Jitter (Rev. 0)PDF291 点击下载
    AN-769: Generating Multiple Clock Outputs from the AD9540 (Rev. 0)PDF130 点击下载
    AN-939: Super-Nyquist Operation of the AD9912 Yields a High RF Output Signal (Rev. 0)PDF221 点击下载
    AN-837: DDS-Based Clock Jitter Performance vs. DAC Reconstruction Filter Performance (Rev. 0)PDF313 点击下载
    AN-823: Direct Digital Synthesizers in Clocking Applications Time (Rev. 0)PDF115 点击下载

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