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1.25GHz 满功率带宽采样及保持 （S/H）
DDR LVDS 输出
易于驱动的 1.5VP-P 输入范围
单 1.8V 电源
低功率：628mW / 592mW / 545mW （总值）
90dB SFDR
68.5dB SNR
用于配置的串行 SPI 端口
可任选的时钟占空比稳定器
低功率睡眠和打盹模式
引脚兼容的 14 位版本
64 引脚 （9mm x 9mm） QFN 封装
一个任选的时钟占空比稳定器在全速和多种时钟占空比条件下实现了更高的性能，因此，这个系列的产品器件可以利用一个正弦波、PECL、LVDS、TTL 或 CMOS 输入对 ENC+ 和 ENC- 输入进行差分驱动。其数字输出为双倍数据速率 （DDR） LVDS.
在整个温度范围内的 DC 规格包括 ±0.26LSB INL （典型值）、±0.16LSB DNL （典型值） 和无漏失码。转换噪声为 0.54LSBRMS.
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